软件版本:vitis2020.2(vivado2020.2) 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA(米联客MZU07A-EG开发硬件平台) 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1.1概述    使用XILINX 的软件工具VIVADO以及XILINX的7代以上的FPGA或者SOC掌握AXI-4总线结束,并且可以灵活使用AXI-4总线技术完成数据的交换,可以让我们在构建强大的FPGA内部总线数据互联通信方面取得高效、高速、标准化的优势。 本文实验目的: 1:学习AXI总线协议包括AXI-FULL、AXI-Lite 2:掌握基于VIVADO工具产生AXI协议模板 3:掌握通过VIVADO工具产生AXI-lite-Slave代码,并且会修改寄存器 4:理解AXI-lite-Slave中自定义寄存器的地址分配 5:掌握通过VIVADO封装AXI-LITE-SLAVE 图形化IP 6:通过仿真验证AXI-LITE IP的工作是否正常。 1.2AXI总线协议介绍1.2.1AXI总线概述在XIINX FPGA的软件工具vivado以及相关IP中有支持三种AXI总线,拥有三种AXI接口,当然用的都是AXI协议。其中三种AXI总线分别为: AXI4:(For high-performance memory-mapped requirements.)主要面向高性能地址映射通信的需求,是面向地址映射的接口,允许最大256轮的数据突发传输; AXI4-Lite:(For simple, low-throughput memory-mapped communication )是一个轻量级的地址映射单次传输接口,占用很少的逻辑单元。 AXI4-Stream:(For high-speed streaming data.)面向高速流数据传输;去掉了地址项,允许无限制的数据突发传输规模。 由于AXI4和AXI4-Lite信号大部分一样,以下只介绍AXI4信号.另外对于AXI4-Stream协议不再本文中接收,后面有单独介绍的文章。 1.2.2AXI-4总线信号功能1:时钟和复位信号  | 方向  | 描述  |  ACLK    | 时钟源    | 全局时钟信号  |  ARESETn    | 复位源  | 全局复位信号,低有效  |  
   写地址通道信号: 信号  | 方向  | 描述  |  AWID   | 主机to从机  | 写地址ID,用来标志一组写信号  |  AWADDR   | 主机to从机  | 写地址,给出一次写突发传输的写地址  |  AWLEN   | 主机to从机  | AWLEN[7:0]决定写传输的突发长度。AXI3只支持1~16次的突发传输(Burst_length=AxLEN[3:0]+1),AXI4扩展突发长度支持INCR突发类型为1~256次传输,对于其他的传输类型依然保持1~16次突发传输(Burst_Length=AxLEN[7:0]+1)。 burst传输具有如下规则: wraping burst ,burst长度必须是2,4,8,16 burst不能跨4KB边界 不支持提前终止burst传输  |  AWSIZE   | 主机to从机  | 写突发大小,给出每次突发传输的字节数支持1、2、4、8、16、32、64、128  |  AWBURST   | 主机to从机  | 突发类型: 2'b00 FIXED:突发传输过程中地址固定,用于FIFO访问 2'b01 INCR :增量突发,传输过程中,地址递增。增加量取决AxSIZE的值。 2'b10 WRAP:回环突发,和增量突发类似,但会在特定高地址的边界处回到低地址处。回环突发的长度只能是2,4,8,16次传输,传输首地址和每次传输的大小对齐。最低的地址整个传输的数据大小对齐。回环边界等于(AxSIZE*AxLEN) 2'b11 Reserved   |  AWLOCK   | 主机to从机  | 总线锁信号,可提供操作的原子性  |  AWCACHE   | 主机to从机  | 内存类型,表明一次传输是怎样通过系统的  |  AWPROT   | 主机to从机  | 保护类型,表明一次传输的特权级及安全等级  |  AWQOS   | 主机to从机  | 质量服务QoS  |  AWREGION   | 主机to从机  | 区域标志,能实现单一物理接口对应的多个逻辑接口  |  AWUSER   | 主机to从机  | 用户自定义信号  |  AWVALID   | 主机to从机  | 有效信号,表明此通道的地址控制信号有效  |  AWREADY   | 从机to主机  | 表明"从"可以接收地址和对应的控制信号  |  
   2:写数据通道信号:信号名      | 方向      | 描述        |  WID   | 主机to从机  | 一次写传输的ID tag  |  WDATA   | 主机to从机  | 写数据  |  WSTRB   | 主机to从机  | WSTRB[n:0]对应于对应的写字节,WSTRB[n]对应WDATA[8n+7:8n]。WVALID为低时,WSTRB可以为任意值,WVALID为高时,WSTRB为高的字节线必须指示有效的数据。  |  WLAST   | 主机to从机  | 表明此次传输是最后一个突发传输  |  WUSER   | 主机to从机  | 用户自定义信号  |  WVALID   | 主机to从机  | 写有效,表明此次写有效  |  WREADY   | 从机to主机  | 表明从机可以接收写数据  |   
 
 
        
    
    
        
            
        	
            
            
        	
            
            
            
            
            
            
            
            	
                
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                                	米联客FMC-SFP模块支持4路SFP光纤接口,最大支持10Gbps速率。可以安装到具有HPC的FMC接口开发板上使用。控 
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                                	FMC-3G SDI子卡测试1.1概述使用FMC-3GSDI子卡来实现 FPGA 通过 GTH 高速收发器从同轴电缆接收 3G-SDI 信号 
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                                	双十一欢乐购!米联客天猫商城和京东商城狂欢15日!2022.10.28-2022.11.11店铺推出满减优惠券!领券下单享 
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                                	1产品概述FEP-CARD-DAQ9248是一款14bits双通道65MSPS ADC采集模块,该方案采用了ADI的AD9248芯片,扩展接口 
                                    67330 
                                 
				
                             
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                                	1产品概述FEP-DAQ976X是一款14bits双通道125MSPS DAC数模转换模块,该方案采用了ADI的AD9767芯片,扩展接口 
                                    42720 
                                 
				
                             
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                                	本文在 AXI_DMA_LOOP 环路测试架构的基础上,在 DATA FIFO 端加入 FPGA 代码,对 FIFO 写,实现将 PL 端数 
                                    101203 
                                 
				
                             
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                                	在前文中我们学习了AXI总线协议,而且通过VIVADO自定义了AXI-LITE总线协议的IP CORE,并且实现了寄存器的读 
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                                	FDMA是米联客的基于AXI4总线协议定制的一个DMA控制器。有了这个IP我们可以统一实现用FPGA代码直接读写PL的D 
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                                	在前文的实验中我们详细介绍了FDMA的使用方法,以及使用了AXI-BRAM演示了FDMA的使用,现在我们已经掌握了FD 
                                    113338 
                                 
				
                             
                         
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                                	1.1 FPGA技术背景笔者也是在偶然的机缘下接触到FPGA的,当初只有感性的认识就是FPGA速 
                                    1079520 
                                 
				
                             
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                                	淘宝购买链接:https://item.taobao.com/item.htm?spm=a1z10.5-c-s.w4002-18659455309 
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                                	在前面的课程种,我们已经提供了FDMA和XDMA配合使用,应用于PCIE传图的方案。但是前面 
                                    14690115 
                                 
				
                             
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                                	8B/10B编码是1983年由IBM公司的Al Widmer和PeterFranaszek所提出的数据传输编码标准, 
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                                	1概述在米联客老版本的MIA701开发板(2017版本)中,米联开源了1套原创的UDP IP协议栈。 
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                                	淘宝购买连接:https://item.taobao.com/item.htm?spm=a1z10.5-c-s.w4002-18659455309 
                                    97298 
                                 
				
                             
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                                	1、电源改动版本使用电压输入电压范围201712275V4.7-5.2V201909185V2.0-16V新版本采用 
                                    65168 
                                 
				
                             
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                                	前面我们完成了一个PCIE中断采集图像的方案,但是很多应用中我们需要采集分析ADC的数 
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                                	本章讲解使用PL端以太网口实现UDP通信。开发板中实现千兆网 UDP 传输的基本逻辑框架如 
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                                	在前文的实验中我们详细介绍了FDMA的使用方法,以及使用了AXI-BRAM演示了FDMA的使用, 
                                    113338 
                                 
				
                             
                         
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                                	米联客FMC-SFP模块支持4路SFP光纤接口,最大支持10Gbps速率。可以安装到具有HPC的FMC 
                                    19580 
                                 
				
                             
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                                	FMC-3G SDI子卡测试1.1概述使用FMC-3GSDI子卡来实现 FPGA 通过 GTH 高速收发器从同轴 
                                    22080 
                                 
				
                             
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                                	双十一欢乐购!米联客天猫商城和京东商城狂欢15日!2022.10.28-2022.11.11店铺推出满 
                                    18060 
                                 
				
                             
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                                	1产品概述FEP-CARD-DAQ9248是一款14bits双通道65MSPS ADC采集模块,该方案采用了ADI的 
                                    67330 
                                 
				
                             
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                                	1产品概述FEP-DAQ976X是一款14bits双通道125MSPS DAC数模转换模块,该方案采用了ADI的 
                                    42720 
                                 
				
                             
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                                	本文在 AXI_DMA_LOOP 环路测试架构的基础上,在 DATA FIFO 端加入 FPGA 代码,对 FIFO 
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                                	在前文中我们学习了AXI总线协议,而且通过VIVADO自定义了AXI-LITE总线协议的IP CORE, 
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                                	FDMA是米联客的基于AXI4总线协议定制的一个DMA控制器。有了这个IP我们可以统一实现用F 
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                                	在前文的实验中我们详细介绍了FDMA的使用方法,以及使用了AXI-BRAM演示了FDMA的使用, 
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                                	基于FDMA可以完成很多数据读写存储类的应用,本文将展示通过FDMA读写AXI-BRAM
本文实 
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