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FPGA编程入门

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预览 19 Verilog语法_低功耗设计 attach_img uisrc 2024-1-7 0364 uisrc 2024-1-7 13:43
预览 18 Verilog语法_FIFO设计 attach_img uisrc 2024-1-7 0352 uisrc 2024-1-7 13:41
预览 17 Verilog语法_时钟分频设计 attach_img uisrc 2024-1-7 0285 uisrc 2024-1-7 13:40
预览 16 Verilog语法_复位设计 uisrc 2024-1-7 0283 uisrc 2024-1-7 13:39
预览 15 Verilog语法_跨时钟域设计 uisrc 2024-1-7 0302 uisrc 2024-1-7 13:31
预览 14 Verilog语法_同步与异步设计 attach_img uisrc 2024-1-7 0290 uisrc 2024-1-7 13:30
预览 13 Verilog语法_流水线设计 attach_img uisrc 2024-1-7 0345 uisrc 2024-1-7 13:30
预览 12 Verilog语法_仿真文件设计 uisrc 2024-1-7 0291 uisrc 2024-1-7 13:29
预览 11 Verilog语法_函数与任务 uisrc 2024-1-7 0262 uisrc 2024-1-7 13:28
预览 10 Verilog语法_一般设计规范 attach_img uisrc 2024-1-7 0393 uisrc 2024-1-7 13:28
预览 09 Verilog语法_竞争与冒险 attach_img uisrc 2024-1-7 0278 uisrc 2024-1-7 13:27
预览 08 Verilog语法_模块端口与例化 uisrc 2024-1-7 0283 uisrc 2024-1-7 13:22
预览 07 Verilog语法_条件与循环语句 uisrc 2024-1-7 0271 uisrc 2024-1-7 13:22
预览 06 Verilog语法_时序控制与语句块 uisrc 2024-1-7 0298 uisrc 2024-1-7 13:22
预览 05 Verilog语法_过程结构与赋值 uisrc 2024-1-7 0350 uisrc 2024-1-7 13:21
预览 04 Verilog语法_数据类型及表达式 uisrc 2024-1-7 0294 uisrc 2024-1-7 13:21
预览 03 Verilog语法_基础语法 uisrc 2024-1-7 0286 uisrc 2024-1-7 13:20
预览 02 Verilog语法_基本设计方法 attach_img uisrc 2024-1-7 0295 uisrc 2024-1-7 13:20
预览 01 Verilog语法_Verilog_HDL语言简介 uisrc 2024-1-7 0294 uisrc 2024-1-7 13:19