问答 店铺
热搜: ZYNQ FPGA discuz

QQ登录

只需一步,快速开始

微信登录

微信扫码,快速开始

微信扫一扫 分享朋友圈

已有 3781 人浏览分享

开启左侧

altera max10某个管脚做下delay

[复制链接]
3781 0
想对某个输入IO做一点时延,或者对不是专用时钟(只有专用时钟才能经过PLL调相)输入的时钟做下相位的调整,不知道有没有什么办法,求解惑,谢谢!!!
您需要登录后才可以回帖 登录 | 立即注册

本版积分规则

精彩推荐
热门资讯
网友晒图
图文推荐

  • 微信公众平台

  • 扫描访问手机版