|
软件版本：Anlogic -TD5.6.1-64bit 操作系统：WIN10 64bit 硬件平台：适用安路(Anlogic)FPGA 1概述前面实验中我们完成了基于TD软件工程的创建、FPGA代码的创建、程序的下载，并且实现了modelsim的联合仿真。本节课实验中，我们将添加chipwatcher 在线逻辑分析仪，通过 ChipWatcher，用户无需借助外部设备即可在线监测电路内部信号的变化情况。在 ChipWatcher 中，用户可同时添加多个信号，在设置信号的采样时钟、采样深度、触发条件及触发位置后，经过重新编译、下载和触发，即可查看到指定条件下的信号变化情况。ChipWatcher 的工作流程如下图所示。 2添加chipwatcher IP核1:新建chipwatcher IP核在开始本实验前，确保FPGA工程已经完成编译，本文继续在前面的实验基础上进行. 可以通过Tools → Debug Tools ，选择 ChipWatcher 也可以直接单击下图的图标添加 2:添加观察信号选择setup 右击选择Add nodes
添加需要观察的信号 在本实验中添加如下信号 Data Enable:是指选择需要采集并显示波形的信号，在复选框中打勾表示使能该信号； Trigger Enable:是指将该信号的某一状态作为触发条件； Mask Enable:可以选择是否需要和设定值进行对比，Mask 状态默认勾选，需要和界面设定值进行对比；取消勾选，不与界面设定值进行对比，对于单个 net，功能类似于 don't care； Trigger Conditions: 是指需满足该条件时才能对信号进行触发； Basic AND:是指需同时满足以下所有触发条件时才能对信号进行触发； Basic OR:是指只要满足以下任一触发条件即可对信号进行触发。
对于1Bit位宽信号，右键单击触发条件一栏，可更改触发条件，如下所示，对于 net 来说，触发条件依次为: 任意位置、低电平、高电平、上升沿、下降沿和双沿（上升沿或下降沿）； 3:设置触发条件比如设置up_led[1:0]=2b11的时候出发。 4:设置采样时钟这里选择clk0_buf同步时钟作为采样时钟 5:选择采样深度和设置触发的位置Pre Position 表示触发位置将处于整个采样数据的前三分之一处； Center Position 表示触发位置将处于整个采样数据的二分之一处； Post Position 表示触发位置将处于整个采样数据的后三分之一处； 6:Chipwatcher创建成功3在线调试首先重新编译工程,编译完成后，双击watcher.cwc 打开后 准备好开发板，接通JTAG并且给开发板通电,并下载程序 可以选择单次触发或者连续触发 右击修改数据显示格式 也可以修改触发条件,比如把up_led[1:0]修改微don't care就是代表任意条件都会触发 再次单次触发，可以看到在up_led[1:0]==2'b00的时候也会触发 4修改已经存在的watcher对于已经存在的watcher可以直接修改，比如这里可以继续右击添加其他需要观察的信号 也可以右击已经存在的信号，并且删除 修改完成后一定记得要再次保存 之后再重新编译，重新调试，这里就不再重复
附录：常见问题1联系方式
米联客社区FPGA/SOC QQ群： 群1:516869816 群2:543731097 群3:86730608 群4:34215299
技术微信：18951232035 技术电话：18951232035
官方微信公众号(新微信公众号)： 2售后1、7天无理由退货(人为原因除外) 2、质保期限：本司产品自快递签收之日起，提供一年质保服务(主芯片，比如FPGA 或者CPU等除外)。 3、维修换货，需提供淘宝订单编号或合同编号，联系销售/技术支持安排退回事宜。 4、以下情形不属于质保范畴。 A:由于用户使用不当造成板子的损坏：比如电压过高造成的开发板短路，自行焊接造成的焊盘脱落、铜线起皮 等 B:用户日常维护不当造成板子的损坏：比如放置不当导致线路板腐蚀、基板出现裂纹等 5、质保范畴外（上方第4条）及质保期限以外的产品，本司提供有偿维修服务。维修仅收取器件材料成本，往返运 费全部由客户承担。 3销售
销售电话：18921033576
公司地址：常州溧阳总部：常州溧阳市中关村吴潭渡路雅创高科智造谷10-1幢楼 南京研发基地：南京市栖霞区仙林大道181号5幢1820室 4在线视频5软件下载6经验分享7官方博文
| 
微信客服01
QQ售前
发表
快速入门demo
1885 人阅读
|
0 人回复
提升卡
置顶卡
沉默卡
喧嚣卡
变色卡
千斤顶
照妖镜